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机译:利用FPGA设计低功耗列旁路乘法器
J. Sudha Rani; R. N. S. Kalpana;
机译:具有列旁路功能的低功耗并行乘法器
机译:行旁路低功耗定宽乘法器的设计
机译:具有行旁路和并行架构的低功耗和高速乘法器设计
机译:使用Altera的设计环境和FPGA设计和实现浮点乘法器
机译:基于FPGA的传感器系统的调查:面向用于计算机视觉控制和信号处理的智能且可重新配置的低功耗传感器
机译:采用straintronics纳米磁体的超低功耗异步处理器和FpGa设计。
机译:FPGA上基于GPHL IO标准的节能型VEDIC乘法器设计
机译:多层堆叠FPGA板用于半导体设计验证
机译:具有旁路电路的低功耗展位阵列乘法器
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